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更新時(shí)間：2025.05.11
實(shí)驗(yàn)13VHDL三態(tài)門

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實(shí)驗(yàn)十三 三態(tài)門、 OC門的設(shè)計(jì)與仿真 一、實(shí)驗(yàn)內(nèi)容 1．在 Quartus II 中用邏輯圖和 VHDL語(yǔ)言設(shè)計(jì)三態(tài)門，三態(tài)門的使能端對(duì)低電平有效。 2．在 Quartus II 中用邏輯圖和 VHDL語(yǔ)言設(shè)計(jì)一個(gè) OC門（集電極開路門）。 二、電路要求 三態(tài)門、 OC門的邏輯圖； 用 VHDL語(yǔ)言設(shè)計(jì)三態(tài)門、 OC門，用盡量多的方法來(lái)描述； 三、電路功能介紹 1．三態(tài)門，又名三態(tài)緩沖器（ Tri-State Buffer ） 用途：用在總線傳輸上，有效而又靈活地控制多組數(shù)據(jù)在總線上通行，起著交通信號(hào)燈 的作用。 邏輯圖 真值表 EN A OUT 0 0 Hi-Z 0 1 Hi-Z 1 0 0 1 1 0 VHDL程序 行為描述： 結(jié)構(gòu)體描述： 波形圖 2．OC門，又名集電極開路門（ opndrn） 用途：集電極開路門（ OC門）是一種用途廣泛的門電路。典型應(yīng)用是可以實(shí) 現(xiàn)線與的功能。

1三態(tài)開關(guān)的工作原理

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1、 三態(tài)開關(guān)的工作原理： DIN DOUT E Din 為數(shù)據(jù)輸入端 Dout 為數(shù)據(jù)輸出端 E 為控制端高電平有效 2、半加器本位和邏輯表達(dá)式 ，半加器進(jìn)位邏輯表達(dá)式，及電路。 3、 全加器本位和邏輯表達(dá)式，全加器向高位進(jìn)位的邏輯表達(dá)式，電路。 4、設(shè)計(jì)一個(gè)具有十個(gè)輸入端的 BCD 碼編碼器？（要求列出真值表，寫出邏輯表達(dá)式，畫 出邏輯框圖） 5、設(shè)計(jì)一個(gè)三八譯碼器： （要求列出真值表，寫出邏輯表達(dá)式，畫出邏輯框圖）

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